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器件相关 (116)更多>>: 关于DVI; DNA加密; QDRII的最低频率问题; FPGA模块加密; 关于Xilinx配置信息加载采集的问题
开发套件 (49)更多>>: NEXYS3驱动; FPGA无法加载EPROM; Spartan3E开发板可否用USB实现与PC的数据传输~~~; SDK使用; AccelDSP生成bit 文件

LogiCORE IP (38)更多>>: ISERDES2; 谁能发个计时器timer调用中断服务函数的实例啊。。; FIR 滤波器IP核的调用; 询问生成rocketio硬核时错误; Virtex-6 DDR2芯片如果一直写，为什么间隔1us出现一个读呢？
嵌入式系统设计 (38)更多>>: 1080P 60fps转1080P 30fps，Xilinx有没有相应的IP core和FPGA推荐; 求助v5 gtp功耗的问题; 用EDK调用网络协议; 求救关于SYSTEM GENTERATOR 数据串行处理并行输出; 这个论坛到底有没有高手？？？？？？？？？？？？？！！！！！！！！！！！！

设计考虑 (38)更多>>: ip核调用; 有没有芯片支持FPGA对SATA硬盘的读写; 求教：Spartan-6设计输出高频时钟问题; 关于MPMC中的NPI接口使用; 求高手指点
安装和设计输入 (13)更多>>: ise 12.4 能够成功的安装，打不开ise软件; 是否可以用其他软件打开ISE中的原理图（Schematic）文件; 是否可以在unix下安装使用？; 9.2i ISE Text Editor - Asian language characters in ISE Text Editor are deleted when entering a new character; 10.1 ISE Text Editor - The text of an HDL file is not correctly highlighted

综合 (23)更多>>: FPGA中的不可综合; Illegal redeclaration of 'dout'; 初拥ISE 报错不知如何解决; xilinx编译出现错误; LVDS输出设置
仿真和验证 (50)更多>>: 时序仿真的问题; 仿真输出始终为“X”态; xilinx 的ISERDES 功能仿真; 后仿真库文件出问题; spartan3能用chipescope么？

时序和约束 (19)更多>>: 请问关于false path网上资料比较少，通常如何在设计中确定false path？; 求助ERROR:Route:537 - A core generated by the Memory Interface Generator (MIG) has been detected in this design; Modelsim时序仿真; 计数器高位不计数; 请教chipscope 初始化扫描链问题，cable connection failed
高级流程 (13)更多>>: 在SDK里执行Run configuration报错了; PicoBlaze的jtag loader怎么使用呀？; 请问有没有用FPGA Editor 完全手动创造一个工程的经历？希望交流一下; 11.2 Smartxplorer - ERROR "Could not determine cost table value from strategy name" while copying the best strategy; 10.1 SmartXplorer - Questions on System Requirements for Host Machines

器件编程 (23)更多>>: pcie trn_tbuf_av[1]变为0; 跪求一程序; 请问XC9572XL可以解密吗？怎样读出里的数据？; .mat文件转换为.coe文件; XC95216-PQG160 -15C 用什么版本的JTAG下载软件？PC3电缆可以吗？
配件设计工具 (15)更多>>: system generator关联matlab出错; 有没有XILINX ISE13.2版本的详细使用手册; How can I get the system generator demos?; v5 Configuration-done don't go high; Xilinx ISE 9.1i支持SystemVerilog的可综合语法吗？

实现 (19)更多>>: bit文件与CDC文件; stm32和cpld的模拟8080并行通信; 多片ＦＰＧＡ的同步工作问题; PIC+Spartan 3e通信，Chipscope观测引脚值有误; 关于电缆连接失败的问题

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